AD9528クロック発生器

Analog Devicesの低ジッタクロックは、高速コンバータでJESD204Bをサポート

Analog DevicesのAD9528クロック発生器の画像 Analog DevicesのAD9528は、複数のデバイスの同期のための統合されたJESD204B SYSREF発生器を備えた2ステージPLLです。 初段位相ロックループ(PLL)(PLL1)は、システムクロックに出現するジッタを低減することにより、入力基準電圧の調整を提供します。 第2段PLL(PLL2)は高周波クロックを提供し、クロック出力ドライバから低い統合ジッタや低広帯域ノイズを達成します。 外部のVCXOは、限定的な位相ノイズおよび許容できる性能を達成するのに必要なジッタ要件を達成するために、PLL2で必要とされる低ノイズリファレンスを提供します。 オンチップVCOは、3.450GHz〜4.025GHzに同調します。 統合されたSYSREF発生器は、シングルショット、Nショット、または複数のデバイスを時間整合させるためにPLL1およびPLL2出力に同期する連続信号を出力します。

AD9528は、1.25GHzの最大周波数および最大1GHzの12の出力を持つ2つの出力(出力1および出力2)を生成します。 各出力は、PLL1、PLL2、または内部SYSREF発生器から直接出力を設定することができます。 14出力チャンネルのそれぞれは、粗いデジタル位相調整およびアナログの微細な位相遅延ブロックを備えた分割器を含み、14のすべての出力にわたってタイミングの位置合わせで完全な柔軟性を可能とします。 AD9528はまた、14のデバイスクロックおよび/またはSYSREF信号を配布するために、デュアル入力の柔軟性のあるバッファとしても使用できます。 電源投入時に、AD9528はパワーアップレディクロックとして機能するVCXO信号を、出力12および出力13に直接送信します。

特長
  • HSTLまたはLVDS用に設定可能な14の出力
  • 最大出力周波数
    • 1.25GHzまでの2つの出力
    • 最大1GHzの12の出力
  • 電圧制御水晶発振器(VCXO)周波数精度(起動周波数精度:<±100ppm)に依存
  • 各出力での専用8ビット分周器
    • 粗調整遅延:ジッタの影響なしでRF VCO分周器出力周波数の1/2期間での63ステップ
    • 微調整遅延:31ps分解能の15ステップ
  • 標準出力〜出力スキュー:20ps
  • 奇数分割器設定のためのデューティサイクル補正
  • 出力12および出力13、起動時のVCXO出力
  • 絶対出力ジッタ:122.88MHzで<160fs、12kHz~20mHzの統合範囲
応用
  • 高性能ワイヤレストランシーバ
  • LTEおよびマルチキャリアGSM基地局
  • ワイヤレスおよび広帯域インフラ
  • 医療用計測器
  • 高速ADC、DAC、DDS、DDC、DUC、MxFEのクロッキング、JESD204Bをサポート
  • 低ジッタ、低位相ノイズクロック分配
  • ATEおよび高性能計測器

Development Boards

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EVAL BOARD FOR AD9528AD9528/PCBZEVAL BOARD FOR AD95280 - 即時See Page for Pricing詳細を表示

AD9528 Clock Generators

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刊行: 2015-03-18