Lattice Semiconductor Corporation - ラティスセミコンダクタ

ECP5™ SERDES対応FPGAファミリ

Lattice SemiconductorのECP5 FPGAファミリは、コネクティビティおよび加速度のアプリケーションで、電力、サイズ、コストの法則を打破

Latticeが提供するECP5™ SERDES対応FPGAファミリの画像多くの新しい大量アプリケーション向けの機器の設計者は、コスト、電力、およびフォームファクタにおける厳しい制約を満たす柔軟なシステムを迅速に構築するために、FPGAをASICおよびASSPと融合しています。 ECP5 FPGAファミリの開発において、Latticeは、すべてのFPGAが最高密度で、電力消費が大きく、高価であるという法則を打ち破っています。 小型、大量アプリケーションに重点を置くLatticeは、低コスト、スモールフォームファクタ、および低消費電力向けにECP5アーキテクチャを最適化しました。 これらの特性により、ECP5デバイスは、ASICおよびASSPを補完するプログラム可能コネクティビティソリューションの提供に最適です。

ビデオ - ECP5 FPGAファミリ

特長
  • 汎用8b10b、10ビットSERDES、および8ビットSERDESモード用の270Mbps～3.2Gbps
  • デュアルチャンネルブロックでデバイスあたり最大4つのチャンネルにより、粒度を向上
  • 強化されたDSPブロックは、対称的なフィルタ向けに2倍のリソース向上を提供
  • 80mW未満（標準）の低静的電力、および1.1Vのコア電圧を備えた低動的電力
  • LVCMOS 33/25/18/15/12、XGMII、LVTTL、LVDS、Bus-LVDS、7:1 LVDS、LVPECL、およびMIPI D-PHY入力インターフェースのプログラム可能IOサポート

Eval Boards

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ECP5™ Series

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刊行： 2015-08-12

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