8SLVD1204/8SLVD1204-33ファンアウトバッファ

Renesasの2.5Vまたは3.3Vのどちらかでの2:4、高性能差動LVDS出力ファンアウトバッファ

Renesasの8SLVD1204および8SLVD1204-33ファンアウトバッファの画像Renesasの8SLVD1204Iおよび8SLVD1204-33Iは、高性能差動LVDSファンアウトバッファです。これらのデバイスは、高周波、非常に低い付加位相ノイズクロックおよびデータ信号のファンアウト用に設計されています。8SLVD1204Iは2.5V電源で動作し、Renesasの8SLVD1204-33Iは3.3V電源で動作することが特徴です。保証された出力対出力および部品間のスキュー特性により、明確な性能と再現性を要求するクロック分配アプリケーションに最適です。2つの選択可能な差動入力と4つの低スキュー出力が入手可能です。統合型バイアス電圧リファレンスは、デバイス入力へのシングルエンド信号の容易なインターフェースを実現します。これらのデバイスは、低消費電力と低い付加位相ノイズ向けに最適化されています。

8SLVD1204-33Iの機能
8SLVD1204Iの機能
  • 4つの低スキュー、低い付加ジッタLVDS出力ペア
  • 2つの選択可能な差動クロック入力ペア
  • 差動PCLKx、nPCLKxペアは次の差動入力レベルを受け入れ可能:LVDS、LVPECL
  • 最大入力クロック周波数:2GHz
  • 制御入力選択ピン用LVCMOS/LVTTLインターフェースレベル
  • 出力スキュー:20ps(最大)
  • 伝播遅延時間:310ps(最大)
  • 低い付加位相ジッタ、RMS、fREF = 156.25MHz、VPP = 1V、10kHz〜20MHz:100fs(最大)
  • 全3.3V電源電圧
  • 鉛フリー(RoHS 6)、16リードVFQFNパッケージング
  • -40°C〜+85°Cの周辺動作周囲
  • 4つの低スキュー、低い付加ジッタLVDS出力ペア
  • 2つの選択可能な差動クロック入力ペア
  • 差動PCLK、nPCLK入力ペアは、次の差動入力レベルを受け入れ可能:LVDS、LVPECL
  • 最大入力クロック周波数:2GHz
  • 制御入力選択ピン用LVCMOS/LVTTLインターフェースレベル
  • 出力スキュー:20ps(最大)
  • 伝播遅延時間:300ps(最大)
  • 低い付加位相ジッタ、RMS、fREF = 156.25MHz、VPP = 1V、10kHz〜20 MHz:95fs(最大)
  • 全2.5V電源電圧
  • 鉛フリー(RoHS 6)、16リードVFQFNパッケージング
  • -40°C〜+85°Cの周辺動作周囲

8SLVD1204 and 8SLVD1204-33 Fanout Buffers

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刊行: 2017-08-09